Professional Documents
Culture Documents
ST2 TTVLSI DoanTheAnh
ST2 TTVLSI DoanTheAnh
HỒ CHÍ MINH
KHOA ĐIỆN – ĐIỆN TỬ
BỘ MÔN KỸ THUẬT MÁY TÍNH – VIỄN THÔNG
MSSV: 21119044
-Đóng Gói :
Sơ đồ đóng gói
-Cấp nguồn tín hiệu :
Phân tích:
-Từ 0µs đến 10µs: Ngõ vào A (đỏ) mức 1 thì ngõ ra Y (xanh) mức 0.
-Từ 10µs đến 20µs: Ngõ vào A (đỏ) mức 0 thì ngõ ra Y (xanh) mức 1.
-Tương tự cho những khoảng thời gian còn lại
- Tính toán thời gian tpdr, tpdf, tr, tf và công suất trung bình của cổng
NOT:
Thông số AC:
-Trường hợp lý tưởng:
*Thời gian trễ truyền: Thời gian trễ truyền được tính từ khi ngõ vào đạt
mức Vdd/2 đến khi ngõ ra đạt mức Vdd/2.
+Độ trễ lan truyền cạnh lên từ A đến Y: t PLH =192,898ps
Đo độ trễ lan truyền cạnh lên từ A đến Y
+Độ trễ lan truyền cạnh xuống từ A đến Y: t PHL=321,639ps