Differential signal and Audio design

rule

EMC TRAINING
 Differential Signal EMC Guide

阻抗控制
終端電阻
濾波器
Differential Signal Layout Guide
 阻抗控制

高速差動信號阻抗匹配是非常重要的 , 即使是一條
很短的路徑上 . 信號上任何阻抗不連續 , 都會造成反
射降低信號品質 .
這些阻抗不連續 , 會造成共模雜訊增加 , 共模雜訊經
會經由外部連接 cable 輻射出去 , 造成 EMI 的問題 .
利用終端電阻和濾波器可降低訊號反射和共模雜訊
減少 EMI 問題 .
差動信號阻抗匹配範圍在 90~100ohm
 終端電阻

Source Terminator
 終端電阻

Ending Terminator
 終端電阻

Other uncommon termination

 濾波器

在理想的狀況 , 共模雜訊應為常數 .
小的共模雜訊通常不會被發現 . 不會造成信號上的完整或
在系統端影響效能 .
在實際設計上像信號轉接處 , 可能會產生共模雜信號 , 這
些共模號可能造成兩個非常重要的問題 ,
a. 如果共模雜訊過高，可能會使接收端的前置放大器飽
和掉無法準確地接收差分信號
b. 如果共模雜訊有任何的變化使得共模雜訊從雙絞線輻
射出 , 它就有可能造成 EMI 的問題
 濾波器

在每一對差動信號中 , 信號不對稱是與生俱來 . 在整條路徑

上共模雜訊無法完全互相抵銷。
造成差動信號不對稱原因如下 :
a. 輸出不平衡的差動驅動器
b. 長度不對稱
c. 終端線路的差異
d. 信號路徑不良的損失 , 彎道 , 貫穿孔轉換等
e. 差動信號轉接處 .
適當的 Common mode filter 可以抑制 , 降低 EMI Noise
 Differential Signal Layout Guide

長度匹配；分段匹配以確保線路長度相等 , 不要在線路最
尾端才做補償的動作
當 pin out 造成的不等長時 , 要在 break-out 125 mil 內補償 .
走線避免 90 度轉角
因在轉角造成的不等長 , 要側的線段 125mil 內補償 .
換層處不要參雜其他的貫穿孔在附近 .
保持之間的走線對稱 .
線路距板邊至少 5 倍線寬
 Differential Signal Layout Guide

差動信號 : 對線信號之間的差異越短越好 . 長度
匹配應分段匹配 . 因不匹配而增加的蛇線 , 應增
加在不匹配處附近
 Differential Signal Layout Guide

避免 90 度轉角；轉角線長大於 250mils 避免電

容效應
 Differential Signal Layout Guide

轉角長度大於 600mils 的補償方式

 Differential Signal Layout Guide

Pair to pair layout 經驗原則：

a. 為了 pair to pair 長度匹配需繞蛇線時 , 為避免平行段
串音產生 , 蛇線長度至少 100 mils 長；間距 30 mils 寬。
b. 蛇紋線邊緣到其他信號邊緣的距離 , 在 strip line 至少
要 3 倍線寬的間距；在 microstrip line 至少要 5 倍線寬
的間距。
c. 轉角的總數應小於 15 個 .
d. 蛇線與蛇線的間距是少要 10 倍線寬
Differential Signal Layout Guide
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Symmetry and Balance

Test point
不可在高速差動信號上放測試點 , 這些測試點對
高速信號相當於線路的分歧
盡可能利用元件上焊點或信號貫穿孔當作測試點
放置測試點 , 保持差動信號 layout 對稱性
 Differential Signal Layout Guide

Vias and pads

信號上貫穿孔會影響信號損失和抖動的程度 .
每一對貫穿孔會有 0.25dB 的損失過多的貫穿孔會影
響佈線的最大長度 .
信號換層的貫孔或測試點要保持對稱
在差動信號上不可有任何線路分歧
當信號換層使用縫補貫孔時 , 貫孔應對稱放置在信號
換層貫孔旁的兩側
Differential Signal Layout Guide
Differential Signal Layout Guide
 Audio design rule

separates the analog and digital ground planes with a 60 to 100 mils
gap
The digital and analog ground planes are tied together by a wide link,
about 50mils, at one point and only one point beneath the codec
JACK DETECTION: one is the resistors network should be placed as close
as possible to the sense pin. Another is the layout traces between the
resistors network and HDA jack should away from any analog trace
because sensing current might distorts the audio performance. The
bottom layer is best choice
Audio design rule
Audio design rule
 Audio design rule

Class D Filter